認証済み設計フローでTSMC N2プロセスでの最先端テストチップのテープアウトに複数回成功、市場投入までの時間を短縮する幅広いIPポートフォリオを開発中
2023年9月25日 カリフォルニア州サニーベール発 - シノプシス(Synopsys, Inc.、Nasdaq上場コード:SNPS)は本日、シノプシスのデジタルならびにカスタム/アナログ設計フローがTSMC社のN2プロセス・テクノロジの認定を取得したことを発表した。これより、より高品質な最先端ノードSoCのより迅速な開発が可能となる。デジタル設計フローは複数のテープアウトを達成し、アナログ設計フローも複数の設計開始に採用されるなど、両フローは強い勢いを見せている。これらの設計フローは、フルスタックのAIベースEDAスイート Synopsys.ai™によってより強力なものとなり、劇的な設計生産性の向上を実現する。TSMC N2プロセス向けに開発中のシノプシス Foundation IPならびにInterface IPは、先進の高性能コンピューティング/AI/モバイル向けSoCへのIP統合リスクを低減し、市場投入までの期間短縮を支援する。さらに、DSO.ai™をはじめとするシノプシスのAIベース設計テクノロジにより、N2設計の最適化を高速に進め、消費電力/性能/面積を向上させることができる。
TSMC社 デザイン・インフラストラクチャ・マネージメント 責任者 Dan Kochpatcharin氏は次のように語っている。「これまで数々の高品質な最先端SoCデザインの短期間での市場投入を実現してきた実績は、シノプシス社との長年の協業の品質証明にほかなりません。シノプシス社のようなデザイン・エコシステム・パートナーと緊密に連携して、当社の最先端プロセス・テクノロジの活用を可能にする業界最高水準のソリューションをフルレンジでお届けすることにより、高性能アプリケーションにこれらのシリコン・テクノロジを活用することの明確なアドバンテージをご提供するとともに、デザインをノードからノードへ迅速に移行するための実証済みのパスをご提供しています」
シノプシス EDAグループ ストラテジ&プロダクトマネージメント担当副社長 Sanjay Baliは次のように述べている。「シノプシスのTSMC N2プロセス向けデジタル/アナログ設計フローは、当社のEDAスタック全体にわたる重要な投資の成果であり、設計者の皆様が、N2設計を早期に開始し、消費電力/性能/チップ集積度をこれまで以上に向上させることでSoCを差別化し、市場投入までの時間を短縮できるよう支援します。TSMC社のプロセス・テクノロジの全世代を通じて同社と緊密に協業することで、お客様の技術革新と競争力強化に必要な比類なきEDA/IPソリューションをご提供することができます」
ノード間での効率的なデザイン再利用
シノプシスのアナログ設計フローは、TSMC社の先端プロセス・ノード間の効率的なデザイン再利用を可能にしている。シノプシスは、認証済みEDAフローの一部として、相互運用可能なプロセス・デザイン・キット(iPDK)と、フルチップ・フィジカル検証サインオフのためのIC Validator™を提供している。
提供可能時期
認証済みEDAフローは、既に提供を開始している。
関連情報
シノプシスについて
Synopsys, Inc.(Nasdaq上場コード:SNPS)は、我々が日々使用しているエレクトロニクス機器やソフトウェア製品を開発する先進企業のパートナーとして、半導体設計からソフトウェア開発に至る領域(Silicon to Software)をカバーするソリューションを提供している。電子設計自動化(EDA)ソリューションならびに半導体設計資産(IP)のグローバル・リーディング・カンパニーとして長年にわたる実績を持ち、業界で最も広範囲をカバーしたアプリケーション・セキュリティ・テスティング・ソリューションならびにサービスを提供しているS&P 500カンパニーである。シノプシスは、最先端の半導体を開発しているSoC(system-on-chip)設計者、よりセキュアでハイ・クオリティなコードを開発しているソフトウェア開発者に、革新的製品の開発に欠かせないソリューションを提供している。
詳細情報は、https://www.synopsys.com/ja-jpより入手可能。
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<お問い合わせ先>
日本シノプシス合同会社 フィールド・マーケティング・グループ 藤井 浩充
TEL: 03-6746-3500
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